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已知某时序逻辑电路共有9个状态，且这9个状态中没有多余的状态，则至少需要（）个触发器完成该电路的设计。

已知某时序逻辑电路共有9个状态，且这9个状态中没有多余的状态，则至少需要（）个触发器完成该电路的设计。
A.2
B.3
C.4
D.9
正确答案：C
标签：状态 电路 触发器
上一条：三个触发器所构成的二进制计数器，最多有（）种计数状态。
下一条：设计同步时序逻辑电路时，若有两个状态等价，可以只保留这两个状态中的一个。