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时序逻辑电路的输出端取数如有问题会产生（）。

时序逻辑电路的输出端取数如有问题会产生（）。
A.时钟脉冲混乱
B.置数端无效
C.清零端无效
D.计数模错误(正确答案)

标签：高级电工考试数模时序

上一条：JK触发器，当JK为（）时，触发器处于翻转状态。

下一条：时序逻辑电路的计数器取相应进制数少一经相应门电路送到（）端。