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电平异步时序逻辑电路不允许两个或两个以上的输入同时为1。（）

电平异步时序逻辑电路不允许两个或两个以上的输入同时为1。（）
A.正确
B.错误
正确答案：B

标签：两个电平时序

上一条：电平异步时序逻辑电路中各反馈回路之间的竞争是由于状态编码引起的。（）

下一条：电路中某点电位的大小与参考点无关。（）