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电平异步时序逻辑电路不允许两个或两个以上输入信号

电平异步时序逻辑电路不允许两个或两个以上输入信号
A.同时为0
B.同时为1
C.同时改变
D.同时作用
正确答案：C
标签：两个 电平 时序
上一条：4线-16线译码器有（）输出信号。
下一条：利用异步清零端构成N进制加法计数器，则应将（）所对应的状态译码后驱动清零控制端。