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计算机组成原理

835在无转发机制的五段基本流水线(取指、译码/读寄存器、运算、访存、写回寄存器)中，下列指令序列存在数据冒险的指令对是（）I1：addRI，R2R3；(R2)+(R3)→R1I2：addR5R2R4；(R2+(R4)→R513：addR4，R5，R3；(R5)+(R3)→R414：addR5，R2R6；(R2)+(R6)→R5

836下列关于总线设计的叙述中，错误的是（）

837单周期处理器中所有指令的指令周期为一个时钟周期。下列关于单周期处理器的叙述中，错误的是（）

838某计算机字长为32位，按字节编址，采用小端(LittleEndian)方式存放数据。假定有一个double型变量，其机器数表示为1122334455667788H，存放在00008040H开始的连续存储单元中，则存储单元00008046H中存放的是（）

839系统将数据从磁盘读到内存的过程包括以下操作：①DMA控制器发出中断请求②初始化DMA控制器并启动磁盘③从磁盘传输块数据到内存缓冲区④执行DMA结束中断服务程序正确的执行顺序是（）

840假定计算机MI和M2具有相同的指令集体系结构(ISA)，主频分别为15GHz和12GHz。在MI和M2上运行某基准程序P，平均CPI分别为2和1，则程序P在MI和M2上运行时间的比值是（）。

841某计算机主存按字节编址，由4个64MX8位的DRAM芯片采用交叉编址方式构成，并与宽度为32位的存储器总线相连，主存每次最多读写32位数据。若double型交量x的主存地址为804001A

842某C语言程序段如下：for(i=0；i〈=9；i++){temp=1：for(j=0；j〈=i；j++)temp*=a[j]；sum+=temp；}下列关于数组a的访问局部性的描述中，正确的是（）

843下列寻址方式中，最适合按下标顺序访问一维数组元素的是（）

844某计算机按字节编址。指令字长固定且只有两种指令格式，其中三地址指令29条，二地场指令107条，每个地址字段为6位，则指令字长至少应该是（）

845下列关于超标量流水线特性的叙述中，正确的是（）Ⅰ能缩短流水线功能段的处理时间I

846下列关于主存储器(MM)和控制存储器(CS)的叙述中，错误的是（）

847下列关于指令流水线数据通路的叙述中，错误的是（）

848下列关于多总线结构的叙述中，错误的是（）

849I/O指令实现的数据传送通常发生在（）

850下到关于多重中断系统的叙述中，错误的是（）

851程序P在机器M上的执行时间是20秒，编译优化后，P执行的指令数减少到原来的70%，而CPI增加到原来的12倍，则P在M上的执行时间是（）

852若x=103，y=-25，则下列表达式采用8位定点补码运算实现时，会发生溢出的是（）

853float型数据常用IEEE754单精度浮点格式表示。假设两个float型变量x和y分别存放在32位寄存器f1和f2中，若(f1)=CC900000H，(f2)=B0C00000H，则x和y之间的关系为（）

854某容量为256MB的存储器由若干4M×8位的DRAM芯片构成，该DRAM芯片的地址引脚和数据引脚总数是（）

855采用指令Cache与数据Cache分离的主要目的是（）

856某计算机有16个通用寄存器，采用32位定长指令字，操作码字段(含寻址方式位)为8位，Store指令的源操作数和目的操作数分别采用寄存器直接寻址和基址寻址方式。若基址寄存器可使用任一通用寄存器，且偏移量用补码表示，则Store指令中偏移量的取值范围是（）

857某计算机采用微程序控制器，共有32条指令，公共的取指令微程序包含2条微指令，各指令对应的微程序平均由4条微指令组成，采用断定法(下地址字段法)确定下条微指令地址，则微指令中下地址字段的位数至少是（）

858某同步总线采用数据线和地址线复用方式，其中地址/数据线有32根，总线时钟频率为66MHz，每个时钟周期传送两次数据(上升沿和下降沿各传送一次数据)，该总线的最大数据传输率(总线带宽)是（）

859计算机硬件能够直接执行的是（）。Ⅰ机器语言程序Ⅱ汇编语言程序Ⅲ硬件描述语言程序

860由3个1和5个0组成的8位二进制补码，能表示的最小整数是（）。

861下列有关浮点数加减运算的叙述中，正确的是（）。Ⅰ对阶操作不会引起阶码上溢或下溢Ⅱ右规和尾数舍入都可能引起阶码上溢Ⅲ左规时可能引起阶码下溢Ⅳ尾数溢出时结果不一定溢出

862假定主存地址为32位，按字节编址，主存和Cache之间采用直接映射方式，主存块大小为4个字，每字32位，采用回写（WriteBack）方式，则能存放4K字数据的Cache的总容量的位数至少是（）。

863假定编评器将赋值语句"x=x+3；专换为指令"addxaddr，3"，其中，xaddr是x对应的存储单元地址。若执行该指令的计算机采用页式虚拟存储理方式，并配有相应的TL

864下列存储器中，在工作明间需要期性刷新的是（）。

865某计算机使用4体交叉编址存储器，假定在存储器总线上出现的主存地址(十进制序列为8005、8006、8007、8008、8001、8002、8003、8004、8000，则可能发生访存冲突的地址对是（）。

866下列有关总线定时的叙述中，错误的是（）。

867若磁盘转速为7200转/分，平均寻道时间为8ms，每个磁道包含1000个扇区，则访问一个扇区的平均存取时间大约是（）。

868将高级语言程序转换为机器级目标代码文件的程序是（）。

869有如下C语言程序段：shortsi=-32767；umsignedshortusi=si；执行上述两条语后，usi的值为（）

870有如下C语言程序段：for(k=0；k〈1000k++)a[k]=a[k]+32若数组a及变量k均为int型，int型数据占4B，数据Cache采用直接映射方式、数据区大小为1KB、块大小为16B，该程序段执行前Cache为空，则该程序段执行过程中访问数组a的Cache缺失率约为（）

871某存储器容量为64KB，按字节编址，地址4000H—5FFFH为ROM区，其余为RAM区若采用8K*4位的SRAM芯片进行设计，则需要该芯片的数量是（）

872某计算机主存空间为4GB，字长为32位，按字节编址，采用32位定长指令字格式。若指令按字边界对齐存放，则程序计数器(PC)和指令寄存器(IR)的位数至少分别是（）

873内部异常(内中断)可分为故障(fault)、陷阱（trap）和终止（abort）三类。下列有关内部异常的叙述中，错误的是（）。

874下列关于冯诺依曼结构计算机基本思想的叙述中，错误的是（）

875考虑以下C语言代码：unsignedshortusi=65535；shortsi=usi；执行上述程序段后，si的值是（）

876下列关于缺页处理的叙述中，错误的是（）

877某计算机采用大端方式，按字节编址。某指令中操作数的机器数为1234FF00H，该操作数采用基址寻址方式，形式地址(用补码表示)为FF12H，基址寄存器内容为F0000000H，则该操作数的LSB(最低有效字节)所在的地址是（）

878下列有关处理器时钟脉冲信号的叙述中，错误的是（）

879在采用取指、译码/取数、执行、访存、写回5段流水线的处理器中，执行如下指令序列，其中s0、s1、s2、s3和t2表示寄存器编号。I1：adds2，s1，s0//R[s2]←R[s1]+R[s0]I2：loads3，0(t2)//R[3]←M[R[t2]+0]I3：adds2，s2，s3//R[2J←R[s2」+R[s3]I4：stores2，0(t2)//M[R[t2]+0]←R[s2]下列指令对中，不存在数据冒险的是（）

880下列关于DMA方式的叙述中，正确的是（）

881某设备以中断方式与CPU进行数据交换，CPU主频为1GHz设备接口中的数据缓冲寄存器为32位，设备的数据传输率为50kB/s。若每次中断开销(包括中断响应和中断处理)为1000个时钟周期，则CPU用于该设备输入/输出的时间占整个CPU时间的百分比最多是（）

882下列关于磁盘存储器的叙述中，错误的是（）

883假定一台计算机采用3通道存储器总线，配套的内存条型号为DDR3-1333，即内存条所接插的存储器总线的工作频率为1333MHz总线宽度为64位，则存储器总线的总带宽大约是（）。

884CPU的CPI与下列（）因素无关。

885下列关于兼容的叙述，正确的是（）。

886下列选项中，能缩短程序执行时间的措施是（）。Ⅰ提高CPU时钟频率Ⅱ优化数据通路结构Ⅲ对程序进行编译优化

887下面有关控制相关的描述中，错误的是（）。

888下列关于超标量流水线的描述中，不正确的是（）。

889若某数采用IEEE754单精度浮点数格式表示为45100000H，则其值为什么。

890用于表示浮点数的阶码的编码通常是什么。

891若浮点数尾数用补码表示，则下列数中为规格化尾数形式的是什么。

892通常浮点数被表示成N=S×r^j的形式，其中哪个选项是正确。

893下列关于补码和移码关系的叙述中，什么是不正确的。

894在计算机中，小数点保存在什么位置。

895+18的IEEE754的32位存放形式哪个选项正确？

896表示定点数时，若要求数值0在计算机中惟一地表示为全0，应使用反码表示。

897浮点数的正负由阶码的正负符号决定。

898浮点数的取值范围由阶码的位数决定，而浮点数的精度由尾数的位数决定。

899在采用DMA方式高速传送数据时，数据传送是什么。

900下述I/O控制方式中，主要由程序实现的是（）。

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