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VerilogHDL中进行行为描述,必须要用到always语句。
VerilogHDL中进行行为描述,必须要用到always语句。
A.正确
B.错误
正确答案:正确
标签:
数字电子技术基础
语句
上一条:
定义:reg[2:0]sum;则If(sum[2:0]=3’d4)和If(sum[2])这两个语句的作用一样。
下一条:
在always块语句中被赋值的变量只能是register型变量。