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从代码always@(posedge CLK or negedge RST)可以看出:
从代码always@(posedge CLK or negedge RST)可以看出:
A.RST是同步信号,高电平有效
B.RST是异步信号,低电平有效
C.RST是同步信号,下降沿有效
D.RST是异步信号,下降沿电平有效
正确答案:RST是异步信号,低电平有效
标签:
EDA技术与Verilog
信号
电平
上一条:
编辑矢量波形文件进行仿真时,需要编辑的是
下一条:
若欲将仿真信号的数据显示格式设置为16进制,应选择属性为: