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如图所示为由或非门构成的基本SR锁存器,输入S、R的约束条件是 。
如图所示为由或非门构成的基本SR锁存器,输入S、R的约束条件是 。
A.SR=0
B.SR=1
C.S+R=0
D.S+R=1
正确答案:SR=0
标签:
电子线路与数字逻辑
非门
条件
上一条:
当传送十进制数5时,在余3BCD码奇校验码的校验位上值应为1。
下一条:
假设JK触发器的现态Qn=0,要求Qn+1=0,则应使 ()。