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已知“a=1b’1;b=3b'001;”那么{a,b}＝（）。
已知“a=1b’1;b=3b'001;”那么{a,b}＝（）。
A.1
B.0011
C.0
D.1001
正确答案：1001
标签：
数字电子技术基础
上一条：
在verilogHDL语言中，a=4b'1011，那么操作：a=（）。
下一条：
每个VerfilogHDL源文件中只准编写一个顶层模块，以module开始，以endmodule结束。