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Verilog语言中子模块引用时只能以实例的方式嵌套在其他模块内，嵌套的层次没有限制。

Verilog语言中子模块引用时只能以实例的方式嵌套在其他模块内，嵌套的层次没有限制。
A.正确
B.错误
正确答案：正确

标签：电子线路设计测试与实验嵌套模块

上一条：可以通过新增以下哪些类型文件添加ChipScope调试IP核（）

下一条：Verilog语言引用的子模块可以是一个设计好的Verilog模块，也可以是别的HDL语言如VHDL语言设计的元件，还可以是IP核模块。