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时钟上升沿敏感的关键词是：

时钟上升沿敏感的关键词是：
A.always
B.module
C.posedge
D.negedge
正确答案：posedge

标签：EDA技术与Verilog 时钟关键词

上一条：下列两项的值是一样的：4'd94'b1001

下一条：含清0控制的锁存器module LATCH2(CLK,D,Q,RST);output Q;input CLK,D,RST;assign Q=(!RST)?（）:(CLK?D.Q);endmodule空格处应该填入：