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logic类型的变量会被综合为（）电路。

logic类型的变量会被综合为（）电路。
A.三态门
B.连线
C.寄存器传输级
D.复用器
正确答案：连线；寄存器传输级

标签：计算机组成原理寄存器变量

上一条：在SystemVerilog模块中定义一个端口必须指明哪些要素（）。

下一条：一个SystemVerilog测试程序需要包含几个要素（）。